| 1 | /* SPDX-License-Identifier: GPL-2.0 |
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| 3 | * Copyright 2016-2018 HabanaLabs, Ltd. |
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| 4 | * All Rights Reserved. |
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| 8 | /************************************ |
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| 9 | ** This is an auto-generated file ** |
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| 10 | ** DO NOT EDIT BELOW ** |
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| 11 | ************************************/ |
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| 13 | #ifndef ASIC_REG_TPC3_QM_REGS_H_ |
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| 14 | #define ASIC_REG_TPC3_QM_REGS_H_ |
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| 16 | /* |
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| 17 | ***************************************** |
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| 18 | * TPC3_QM (Prototype: QMAN) |
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| 19 | ***************************************** |
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| 20 | */ |
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| 22 | #define mmTPC3_QM_GLBL_CFG0 0xEC8000 |
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| 23 | |
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| 24 | #define mmTPC3_QM_GLBL_CFG1 0xEC8004 |
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| 25 | |
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| 26 | #define mmTPC3_QM_GLBL_PROT 0xEC8008 |
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| 27 | |
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| 28 | #define mmTPC3_QM_GLBL_ERR_CFG 0xEC800C |
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| 29 | |
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| 30 | #define mmTPC3_QM_GLBL_ERR_ADDR_LO 0xEC8010 |
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| 31 | |
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| 32 | #define mmTPC3_QM_GLBL_ERR_ADDR_HI 0xEC8014 |
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| 33 | |
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| 34 | #define mmTPC3_QM_GLBL_ERR_WDATA 0xEC8018 |
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| 35 | |
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| 36 | #define mmTPC3_QM_GLBL_SECURE_PROPS 0xEC801C |
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| 38 | #define mmTPC3_QM_GLBL_NON_SECURE_PROPS 0xEC8020 |
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| 39 | |
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| 40 | #define mmTPC3_QM_GLBL_STS0 0xEC8024 |
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| 42 | #define mmTPC3_QM_GLBL_STS1 0xEC8028 |
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| 44 | #define mmTPC3_QM_PQ_BASE_LO 0xEC8060 |
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| 46 | #define mmTPC3_QM_PQ_BASE_HI 0xEC8064 |
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| 48 | #define mmTPC3_QM_PQ_SIZE 0xEC8068 |
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| 49 | |
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| 50 | #define mmTPC3_QM_PQ_PI 0xEC806C |
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| 52 | #define mmTPC3_QM_PQ_CI 0xEC8070 |
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| 54 | #define mmTPC3_QM_PQ_CFG0 0xEC8074 |
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| 56 | #define mmTPC3_QM_PQ_CFG1 0xEC8078 |
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| 58 | #define mmTPC3_QM_PQ_ARUSER 0xEC807C |
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| 60 | #define mmTPC3_QM_PQ_PUSH0 0xEC8080 |
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| 62 | #define mmTPC3_QM_PQ_PUSH1 0xEC8084 |
|---|
| 63 | |
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| 64 | #define mmTPC3_QM_PQ_PUSH2 0xEC8088 |
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| 66 | #define mmTPC3_QM_PQ_PUSH3 0xEC808C |
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| 68 | #define mmTPC3_QM_PQ_STS0 0xEC8090 |
|---|
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| 70 | #define mmTPC3_QM_PQ_STS1 0xEC8094 |
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| 74 | #define mmTPC3_QM_PQ_RD_RATE_LIM_RST_TOKEN 0xEC80A4 |
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| 76 | #define mmTPC3_QM_PQ_RD_RATE_LIM_SAT 0xEC80A8 |
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| 78 | #define mmTPC3_QM_PQ_RD_RATE_LIM_TOUT 0xEC80AC |
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| 80 | #define mmTPC3_QM_CQ_CFG0 0xEC80B0 |
|---|
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| 82 | #define mmTPC3_QM_CQ_CFG1 0xEC80B4 |
|---|
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| 84 | #define mmTPC3_QM_CQ_ARUSER 0xEC80B8 |
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| 86 | #define mmTPC3_QM_CQ_PTR_LO 0xEC80C0 |
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| 98 | #define mmTPC3_QM_CQ_TSIZE_STS 0xEC80DC |
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| 126 | #define mmTPC3_QM_CP_MSG_BASE2_ADDR_HI 0xEC8134 |
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| 129 | |
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| 130 | #define mmTPC3_QM_CP_MSG_BASE3_ADDR_HI 0xEC813C |
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| 132 | #define mmTPC3_QM_CP_LDMA_TSIZE_OFFSET 0xEC8140 |
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| 140 | #define mmTPC3_QM_CP_LDMA_DST_BASE_HI_OFFSET 0xEC8150 |
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| 178 | #endif /* ASIC_REG_TPC3_QM_REGS_H_ */ |
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