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| 21 | * |
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| 22 | */ |
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| 23 | #ifndef _vcn_4_0_0_OFFSET_HEADER |
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| 24 | #define |
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| 26 | |
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| 28 | // addressBlock: uvd0_uvddec |
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| 29 | // base address: 0x1fb00 |
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| 469 | #define regUVD_MPC_SET_ALU_BASE_IDX 1 |
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| 477 | #define regUVD_MPC_IND_DATA_BASE_IDX 1 |
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| 479 | |
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| 480 | // addressBlock: uvd0_uvd_rbcdec |
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|---|
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| 491 | #define regUVD_RBC_VCPU_ACCESS_BASE_IDX 1 |
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| 495 | #define regUVD_RBC_READ_REQ_URGENT_CNTL_BASE_IDX 1 |
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|---|
| 497 | #define regUVD_RBC_RB_WPTR_CNTL_BASE_IDX 1 |
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| 503 | #define regUVD_RBC_WPTR_POLL_ADDR_BASE_IDX 1 |
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| 505 | #define regUVD_SEMA_CMD_BASE_IDX 1 |
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| 509 | #define regUVD_SEMA_ADDR_HIGH_BASE_IDX 1 |
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| 511 | #define regUVD_ENGINE_CNTL_BASE_IDX 1 |
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| 513 | #define regUVD_SEMA_TIMEOUT_STATUS_BASE_IDX 1 |
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|---|
| 517 | #define regUVD_SEMA_SIGNAL_INCOMPLETE_TIMEOUT_CNTL_BASE_IDX 1 |
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| 519 | #define regUVD_SEMA_WAIT_FAULT_TIMEOUT_CNTL_BASE_IDX 1 |
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| 521 | #define regUVD_SEMA_WAIT_INCOMPLETE_TIMEOUT_CNTL_BASE_IDX 1 |
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| 522 | #define regUVD_JOB_START 0x01fb |
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| 523 | #define regUVD_JOB_START_BASE_IDX 1 |
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| 525 | #define regUVD_RBC_BUF_STATUS_BASE_IDX 1 |
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|---|
| 527 | #define regUVD_RBC_SWAP_CNTL_BASE_IDX 1 |
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| 528 | |
|---|
| 529 | |
|---|
| 530 | // addressBlock: uvd0_lmi_adpdec |
|---|
| 531 | // base address: 0x20090 |
|---|
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| 955 | #define regUVD_JMI_PERFMON_COUNT_HI_BASE_IDX 1 |
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| 957 | #define regUVD_JMI_CLEAN_STATUS_BASE_IDX 1 |
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| 959 | #define regUVD_LMI_JPEG_READ_64BIT_BAR_LOW_BASE_IDX 1 |
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| 960 | #define regUVD_LMI_JPEG_READ_64BIT_BAR_HIGH 0x06a1 |
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| 961 | #define regUVD_LMI_JPEG_READ_64BIT_BAR_HIGH_BASE_IDX 1 |
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| 962 | #define regUVD_LMI_JPEG_WRITE_64BIT_BAR_LOW 0x06a2 |
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| 963 | #define regUVD_LMI_JPEG_WRITE_64BIT_BAR_LOW_BASE_IDX 1 |
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| 964 | #define regUVD_LMI_JPEG_WRITE_64BIT_BAR_HIGH 0x06a3 |
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| 965 | #define regUVD_LMI_JPEG_WRITE_64BIT_BAR_HIGH_BASE_IDX 1 |
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| 966 | #define regUVD_LMI_JPEG_PREEMPT_FENCE_64BIT_BAR_LOW 0x06a4 |
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| 967 | #define regUVD_LMI_JPEG_PREEMPT_FENCE_64BIT_BAR_LOW_BASE_IDX 1 |
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| 968 | #define regUVD_LMI_JPEG_PREEMPT_FENCE_64BIT_BAR_HIGH 0x06a5 |
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| 969 | #define regUVD_LMI_JPEG_PREEMPT_FENCE_64BIT_BAR_HIGH_BASE_IDX 1 |
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| 973 | #define regUVD_LMI_JRBC_RB_64BIT_BAR_HIGH_BASE_IDX 1 |
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| 975 | #define regUVD_LMI_JRBC_IB_64BIT_BAR_LOW_BASE_IDX 1 |
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| 977 | #define regUVD_LMI_JRBC_IB_64BIT_BAR_HIGH_BASE_IDX 1 |
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| 978 | #define regUVD_LMI_JRBC_RB_MEM_WR_64BIT_BAR_LOW 0x06aa |
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| 979 | #define regUVD_LMI_JRBC_RB_MEM_WR_64BIT_BAR_LOW_BASE_IDX 1 |
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|---|
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| 1079 | #define regUVD_JMI_DEC_SWAP_CNTL2_BASE_IDX 1 |
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|---|
| 1111 | |
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| 1112 | // addressBlock: uvd0_uvd_jpeg_common_sclk_dec |
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| 1131 | #define regJPEG_PERF_BANK_CONF_BASE_IDX 1 |
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|---|
| 1143 | |
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|---|
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| 1153 | #define regUVD_JPEG_POWER_STATUS_BASE_IDX 1 |
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|---|
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| 1203 | #define regUVD_DPG_VCPU_CACHE_OFFSET0_BASE_IDX 1 |
|---|
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|---|
| 1205 | #define regUVD_DPG_LMI_VCPU_CACHE_VMID_BASE_IDX 1 |
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|---|
| 1207 | #define regUVD_FW_VERSION_BASE_IDX 1 |
|---|
| 1208 | #define regUVD_PF_STATUS 0x002c |
|---|
| 1209 | #define regUVD_PF_STATUS_BASE_IDX 1 |
|---|
| 1210 | #define regUVD_DPG_CLK_EN_VCPU_REPORT 0x002e |
|---|
| 1211 | #define regUVD_DPG_CLK_EN_VCPU_REPORT_BASE_IDX 1 |
|---|
| 1212 | #define regUVD_GFX8_ADDR_CONFIG 0x0041 |
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| 1213 | #define regUVD_GFX8_ADDR_CONFIG_BASE_IDX 1 |
|---|
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| 1215 | #define regUVD_GFX10_ADDR_CONFIG_BASE_IDX 1 |
|---|
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| 1217 | #define regUVD_GPCNT2_CNTL_BASE_IDX 1 |
|---|
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| 1223 | #define regUVD_GPCNT2_TARGET_UPPER_BASE_IDX 1 |
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| 1229 | #define regUVD_GPCNT3_TARGET_LOWER_BASE_IDX 1 |
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| 1231 | #define regUVD_GPCNT3_STATUS_LOWER_BASE_IDX 1 |
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| 1245 | #define regVCN_FEATURES_BASE_IDX 1 |
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|---|
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|---|
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| 1267 | #define regUVD_SCRATCH19_BASE_IDX 1 |
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| 1291 | #define regUVD_SCRATCH31_BASE_IDX 1 |
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| 1295 | #define regUVD_VERSION_BASE_IDX 1 |
|---|
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| 1309 | #define regVCN_UMSCH_RB_DB_CTRL_BASE_IDX 1 |
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| 1313 | #define regVCN_AGDB_CTRL1_BASE_IDX 1 |
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|---|
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|---|
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|---|
| 1323 | #define regVCN_AGDB_MASK0_BASE_IDX 1 |
|---|
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|---|
| 1325 | #define regVCN_AGDB_MASK1_BASE_IDX 1 |
|---|
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|---|
| 1327 | #define regVCN_AGDB_MASK2_BASE_IDX 1 |
|---|
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|---|
| 1329 | #define regVCN_AGDB_MASK3_BASE_IDX 1 |
|---|
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| 1331 | #define regVCN_AGDB_MASK4_BASE_IDX 1 |
|---|
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|---|
| 1333 | #define regVCN_AGDB_MASK5_BASE_IDX 1 |
|---|
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|---|
| 1335 | #define regVCN_RB_ENABLE_BASE_IDX 1 |
|---|
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|---|
| 1337 | #define regVCN_RB_WPTR_CTRL_BASE_IDX 1 |
|---|
| 1338 | #define regUVD_RB_RPTR 0x00ac |
|---|
| 1339 | #define regUVD_RB_RPTR_BASE_IDX 1 |
|---|
| 1340 | #define regUVD_RB_WPTR 0x00ad |
|---|
| 1341 | #define regUVD_RB_WPTR_BASE_IDX 1 |
|---|
| 1342 | #define regUVD_RB_RPTR2 0x00ae |
|---|
| 1343 | #define regUVD_RB_RPTR2_BASE_IDX 1 |
|---|
| 1344 | #define regUVD_RB_WPTR2 0x00af |
|---|
| 1345 | #define regUVD_RB_WPTR2_BASE_IDX 1 |
|---|
| 1346 | #define regUVD_RB_RPTR3 0x00b0 |
|---|
| 1347 | #define regUVD_RB_RPTR3_BASE_IDX 1 |
|---|
| 1348 | #define regUVD_RB_WPTR3 0x00b1 |
|---|
| 1349 | #define regUVD_RB_WPTR3_BASE_IDX 1 |
|---|
| 1350 | #define regUVD_RB_RPTR4 0x00b2 |
|---|
| 1351 | #define regUVD_RB_RPTR4_BASE_IDX 1 |
|---|
| 1352 | #define regUVD_RB_WPTR4 0x00b3 |
|---|
| 1353 | #define regUVD_RB_WPTR4_BASE_IDX 1 |
|---|
| 1354 | #define regUVD_OUT_RB_RPTR 0x00b4 |
|---|
| 1355 | #define regUVD_OUT_RB_RPTR_BASE_IDX 1 |
|---|
| 1356 | #define regUVD_OUT_RB_WPTR 0x00b5 |
|---|
| 1357 | #define regUVD_OUT_RB_WPTR_BASE_IDX 1 |
|---|
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|---|
| 1359 | #define regUVD_AUDIO_RB_RPTR_BASE_IDX 1 |
|---|
| 1360 | #define regUVD_AUDIO_RB_WPTR 0x00b7 |
|---|
| 1361 | #define regUVD_AUDIO_RB_WPTR_BASE_IDX 1 |
|---|
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|---|
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|---|
| 1365 | #define regUVD_RBC_RB_WPTR_BASE_IDX 1 |
|---|
| 1366 | #define regUVD_DPG_LMA_CTL2 0x00bb |
|---|
| 1367 | #define regUVD_DPG_LMA_CTL2_BASE_IDX 1 |
|---|
| 1368 | |
|---|
| 1369 | |
|---|
| 1370 | // addressBlock: uvd0_mmsch_dec |
|---|
| 1371 | // base address: 0x20d00 |
|---|
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|---|
| 1373 | #define regMMSCH_UCODE_ADDR_BASE_IDX 1 |
|---|
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| 1375 | #define regMMSCH_UCODE_DATA_BASE_IDX 1 |
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|---|
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|---|
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| 1379 | #define regMMSCH_SRAM_DATA_BASE_IDX 1 |
|---|
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|---|
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|---|
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|---|
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|---|
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|---|
| 1385 | #define regMMSCH_CTX_SRAM_OFFSET_BASE_IDX 1 |
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| 1387 | #define regMMSCH_INTR_BASE_IDX 1 |
|---|
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|---|
| 1389 | #define regMMSCH_INTR_ACK_BASE_IDX 1 |
|---|
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|---|
| 1391 | #define regMMSCH_INTR_STATUS_BASE_IDX 1 |
|---|
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|---|
| 1393 | #define regMMSCH_VF_VMID_BASE_IDX 1 |
|---|
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|---|
| 1395 | #define regMMSCH_VF_CTX_ADDR_LO_BASE_IDX 1 |
|---|
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|---|
| 1397 | #define regMMSCH_VF_CTX_ADDR_HI_BASE_IDX 1 |
|---|
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|---|
| 1399 | #define regMMSCH_VF_CTX_SIZE_BASE_IDX 1 |
|---|
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|---|
| 1401 | #define regMMSCH_VF_GPCOM_ADDR_LO_BASE_IDX 1 |
|---|
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|---|
| 1403 | #define regMMSCH_VF_GPCOM_ADDR_HI_BASE_IDX 1 |
|---|
| 1404 | #define regMMSCH_VF_GPCOM_SIZE 0x0551 |
|---|
| 1405 | #define regMMSCH_VF_GPCOM_SIZE_BASE_IDX 1 |
|---|
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|---|
| 1407 | #define regMMSCH_VF_MAILBOX_HOST_BASE_IDX 1 |
|---|
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|---|
| 1409 | #define regMMSCH_VF_MAILBOX_RESP_BASE_IDX 1 |
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|---|
| 1412 | #define regMMSCH_VF_MAILBOX_0_RESP 0x0555 |
|---|
| 1413 | #define regMMSCH_VF_MAILBOX_0_RESP_BASE_IDX 1 |
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|---|
| 1415 | #define regMMSCH_VF_MAILBOX_1_BASE_IDX 1 |
|---|
| 1416 | #define regMMSCH_VF_MAILBOX_1_RESP 0x0557 |
|---|
| 1417 | #define regMMSCH_VF_MAILBOX_1_RESP_BASE_IDX 1 |
|---|
| 1418 | #define regMMSCH_CNTL 0x055c |
|---|
| 1419 | #define regMMSCH_CNTL_BASE_IDX 1 |
|---|
| 1420 | #define regMMSCH_NONCACHE_OFFSET0 0x055d |
|---|
| 1421 | #define regMMSCH_NONCACHE_OFFSET0_BASE_IDX 1 |
|---|
| 1422 | #define regMMSCH_NONCACHE_SIZE0 0x055e |
|---|
| 1423 | #define regMMSCH_NONCACHE_SIZE0_BASE_IDX 1 |
|---|
| 1424 | #define regMMSCH_NONCACHE_OFFSET1 0x055f |
|---|
| 1425 | #define regMMSCH_NONCACHE_OFFSET1_BASE_IDX 1 |
|---|
| 1426 | #define regMMSCH_NONCACHE_SIZE1 0x0560 |
|---|
| 1427 | #define regMMSCH_NONCACHE_SIZE1_BASE_IDX 1 |
|---|
| 1428 | #define regMMSCH_PROC_STATE1 0x0566 |
|---|
| 1429 | #define regMMSCH_PROC_STATE1_BASE_IDX 1 |
|---|
| 1430 | #define regMMSCH_LAST_MC_ADDR 0x0567 |
|---|
| 1431 | #define regMMSCH_LAST_MC_ADDR_BASE_IDX 1 |
|---|
| 1432 | #define regMMSCH_LAST_MEM_ACCESS_HI 0x0568 |
|---|
| 1433 | #define regMMSCH_LAST_MEM_ACCESS_HI_BASE_IDX 1 |
|---|
| 1434 | #define regMMSCH_LAST_MEM_ACCESS_LO 0x0569 |
|---|
| 1435 | #define regMMSCH_LAST_MEM_ACCESS_LO_BASE_IDX 1 |
|---|
| 1436 | #define regMMSCH_SCRATCH_0 0x056b |
|---|
| 1437 | #define regMMSCH_SCRATCH_0_BASE_IDX 1 |
|---|
| 1438 | #define regMMSCH_SCRATCH_1 0x056c |
|---|
| 1439 | #define regMMSCH_SCRATCH_1_BASE_IDX 1 |
|---|
| 1440 | #define regMMSCH_GPUIOV_SCH_BLOCK_0 0x056d |
|---|
| 1441 | #define regMMSCH_GPUIOV_SCH_BLOCK_0_BASE_IDX 1 |
|---|
| 1442 | #define regMMSCH_GPUIOV_CMD_CONTROL_0 0x056e |
|---|
| 1443 | #define regMMSCH_GPUIOV_CMD_CONTROL_0_BASE_IDX 1 |
|---|
| 1444 | #define regMMSCH_GPUIOV_CMD_STATUS_0 0x056f |
|---|
| 1445 | #define regMMSCH_GPUIOV_CMD_STATUS_0_BASE_IDX 1 |
|---|
| 1446 | #define regMMSCH_GPUIOV_VM_BUSY_STATUS_0 0x0570 |
|---|
| 1447 | #define regMMSCH_GPUIOV_VM_BUSY_STATUS_0_BASE_IDX 1 |
|---|
| 1448 | #define regMMSCH_GPUIOV_ACTIVE_FCNS_0 0x0571 |
|---|
| 1449 | #define regMMSCH_GPUIOV_ACTIVE_FCNS_0_BASE_IDX 1 |
|---|
| 1450 | #define regMMSCH_GPUIOV_DW6_0 0x0573 |
|---|
| 1451 | #define regMMSCH_GPUIOV_DW6_0_BASE_IDX 1 |
|---|
| 1452 | #define regMMSCH_GPUIOV_DW7_0 0x0574 |
|---|
| 1453 | #define regMMSCH_GPUIOV_DW7_0_BASE_IDX 1 |
|---|
| 1454 | #define regMMSCH_GPUIOV_DW8_0 0x0575 |
|---|
| 1455 | #define regMMSCH_GPUIOV_DW8_0_BASE_IDX 1 |
|---|
| 1456 | #define regMMSCH_GPUIOV_SCH_BLOCK_1 0x0576 |
|---|
| 1457 | #define regMMSCH_GPUIOV_SCH_BLOCK_1_BASE_IDX 1 |
|---|
| 1458 | #define regMMSCH_GPUIOV_CMD_CONTROL_1 0x0577 |
|---|
| 1459 | #define regMMSCH_GPUIOV_CMD_CONTROL_1_BASE_IDX 1 |
|---|
| 1460 | #define regMMSCH_GPUIOV_CMD_STATUS_1 0x0578 |
|---|
| 1461 | #define regMMSCH_GPUIOV_CMD_STATUS_1_BASE_IDX 1 |
|---|
| 1462 | #define regMMSCH_GPUIOV_VM_BUSY_STATUS_1 0x0579 |
|---|
| 1463 | #define regMMSCH_GPUIOV_VM_BUSY_STATUS_1_BASE_IDX 1 |
|---|
| 1464 | #define regMMSCH_GPUIOV_ACTIVE_FCNS_1 0x057a |
|---|
| 1465 | #define regMMSCH_GPUIOV_ACTIVE_FCNS_1_BASE_IDX 1 |
|---|
| 1466 | #define regMMSCH_GPUIOV_DW6_1 0x057c |
|---|
| 1467 | #define regMMSCH_GPUIOV_DW6_1_BASE_IDX 1 |
|---|
| 1468 | #define regMMSCH_GPUIOV_DW7_1 0x057d |
|---|
| 1469 | #define regMMSCH_GPUIOV_DW7_1_BASE_IDX 1 |
|---|
| 1470 | #define regMMSCH_GPUIOV_DW8_1 0x057e |
|---|
| 1471 | #define regMMSCH_GPUIOV_DW8_1_BASE_IDX 1 |
|---|
| 1472 | #define regMMSCH_GPUIOV_CNTXT 0x057f |
|---|
| 1473 | #define regMMSCH_GPUIOV_CNTXT_BASE_IDX 1 |
|---|
| 1474 | #define regMMSCH_SCRATCH_2 0x0580 |
|---|
| 1475 | #define regMMSCH_SCRATCH_2_BASE_IDX 1 |
|---|
| 1476 | #define regMMSCH_SCRATCH_3 0x0581 |
|---|
| 1477 | #define regMMSCH_SCRATCH_3_BASE_IDX 1 |
|---|
| 1478 | #define regMMSCH_SCRATCH_4 0x0582 |
|---|
| 1479 | #define regMMSCH_SCRATCH_4_BASE_IDX 1 |
|---|
| 1480 | #define regMMSCH_SCRATCH_5 0x0583 |
|---|
| 1481 | #define regMMSCH_SCRATCH_5_BASE_IDX 1 |
|---|
| 1482 | #define regMMSCH_SCRATCH_6 0x0584 |
|---|
| 1483 | #define regMMSCH_SCRATCH_6_BASE_IDX 1 |
|---|
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|---|
| 1485 | #define regMMSCH_SCRATCH_7_BASE_IDX 1 |
|---|
| 1486 | #define regMMSCH_VFID_FIFO_HEAD_0 0x0586 |
|---|
| 1487 | #define regMMSCH_VFID_FIFO_HEAD_0_BASE_IDX 1 |
|---|
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|---|
| 1489 | #define regMMSCH_VFID_FIFO_TAIL_0_BASE_IDX 1 |
|---|
| 1490 | #define regMMSCH_VFID_FIFO_HEAD_1 0x0588 |
|---|
| 1491 | #define regMMSCH_VFID_FIFO_HEAD_1_BASE_IDX 1 |
|---|
| 1492 | #define regMMSCH_VFID_FIFO_TAIL_1 0x0589 |
|---|
| 1493 | #define regMMSCH_VFID_FIFO_TAIL_1_BASE_IDX 1 |
|---|
| 1494 | #define regMMSCH_NACK_STATUS 0x058a |
|---|
| 1495 | #define regMMSCH_NACK_STATUS_BASE_IDX 1 |
|---|
| 1496 | #define regMMSCH_VF_MAILBOX0_DATA 0x058b |
|---|
| 1497 | #define regMMSCH_VF_MAILBOX0_DATA_BASE_IDX 1 |
|---|
| 1498 | #define regMMSCH_VF_MAILBOX1_DATA 0x058c |
|---|
| 1499 | #define regMMSCH_VF_MAILBOX1_DATA_BASE_IDX 1 |
|---|
| 1500 | #define regMMSCH_GPUIOV_SCH_BLOCK_IP_0 0x058d |
|---|
| 1501 | #define regMMSCH_GPUIOV_SCH_BLOCK_IP_0_BASE_IDX 1 |
|---|
| 1502 | #define regMMSCH_GPUIOV_CMD_STATUS_IP_0 0x058e |
|---|
| 1503 | #define regMMSCH_GPUIOV_CMD_STATUS_IP_0_BASE_IDX 1 |
|---|
| 1504 | #define regMMSCH_GPUIOV_SCH_BLOCK_IP_1 0x0590 |
|---|
| 1505 | #define regMMSCH_GPUIOV_SCH_BLOCK_IP_1_BASE_IDX 1 |
|---|
| 1506 | #define regMMSCH_GPUIOV_CMD_STATUS_IP_1 0x0591 |
|---|
| 1507 | #define regMMSCH_GPUIOV_CMD_STATUS_IP_1_BASE_IDX 1 |
|---|
| 1508 | #define regMMSCH_GPUIOV_CNTXT_IP 0x0593 |
|---|
| 1509 | #define regMMSCH_GPUIOV_CNTXT_IP_BASE_IDX 1 |
|---|
| 1510 | #define regMMSCH_GPUIOV_SCH_BLOCK_2 0x0594 |
|---|
| 1511 | #define regMMSCH_GPUIOV_SCH_BLOCK_2_BASE_IDX 1 |
|---|
| 1512 | #define regMMSCH_GPUIOV_CMD_CONTROL_2 0x0595 |
|---|
| 1513 | #define regMMSCH_GPUIOV_CMD_CONTROL_2_BASE_IDX 1 |
|---|
| 1514 | #define regMMSCH_GPUIOV_CMD_STATUS_2 0x0596 |
|---|
| 1515 | #define regMMSCH_GPUIOV_CMD_STATUS_2_BASE_IDX 1 |
|---|
| 1516 | #define regMMSCH_GPUIOV_VM_BUSY_STATUS_2 0x0597 |
|---|
| 1517 | #define regMMSCH_GPUIOV_VM_BUSY_STATUS_2_BASE_IDX 1 |
|---|
| 1518 | #define regMMSCH_GPUIOV_ACTIVE_FCNS_2 0x0598 |
|---|
| 1519 | #define regMMSCH_GPUIOV_ACTIVE_FCNS_2_BASE_IDX 1 |
|---|
| 1520 | #define regMMSCH_GPUIOV_DW6_2 0x059a |
|---|
| 1521 | #define regMMSCH_GPUIOV_DW6_2_BASE_IDX 1 |
|---|
| 1522 | #define regMMSCH_GPUIOV_DW7_2 0x059b |
|---|
| 1523 | #define regMMSCH_GPUIOV_DW7_2_BASE_IDX 1 |
|---|
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|---|
| 1525 | #define regMMSCH_GPUIOV_DW8_2_BASE_IDX 1 |
|---|
| 1526 | #define regMMSCH_GPUIOV_SCH_BLOCK_IP_2 0x059d |
|---|
| 1527 | #define regMMSCH_GPUIOV_SCH_BLOCK_IP_2_BASE_IDX 1 |
|---|
| 1528 | #define regMMSCH_GPUIOV_CMD_STATUS_IP_2 0x059e |
|---|
| 1529 | #define regMMSCH_GPUIOV_CMD_STATUS_IP_2_BASE_IDX 1 |
|---|
| 1530 | #define regMMSCH_VFID_FIFO_HEAD_2 0x05a0 |
|---|
| 1531 | #define regMMSCH_VFID_FIFO_HEAD_2_BASE_IDX 1 |
|---|
| 1532 | #define regMMSCH_VFID_FIFO_TAIL_2 0x05a1 |
|---|
| 1533 | #define regMMSCH_VFID_FIFO_TAIL_2_BASE_IDX 1 |
|---|
| 1534 | #define regMMSCH_VM_BUSY_STATUS_0 0x05a2 |
|---|
| 1535 | #define regMMSCH_VM_BUSY_STATUS_0_BASE_IDX 1 |
|---|
| 1536 | #define regMMSCH_VM_BUSY_STATUS_1 0x05a3 |
|---|
| 1537 | #define regMMSCH_VM_BUSY_STATUS_1_BASE_IDX 1 |
|---|
| 1538 | #define regMMSCH_VM_BUSY_STATUS_2 0x05a4 |
|---|
| 1539 | #define regMMSCH_VM_BUSY_STATUS_2_BASE_IDX 1 |
|---|
| 1540 | |
|---|
| 1541 | |
|---|
| 1542 | // addressBlock: uvd0_slmi_adpdec |
|---|
| 1543 | // base address: 0x21c00 |
|---|
| 1544 | #define regUVD_LMI_MMSCH_NC0_64BIT_BAR_LOW 0x0900 |
|---|
| 1545 | #define regUVD_LMI_MMSCH_NC0_64BIT_BAR_LOW_BASE_IDX 1 |
|---|
| 1546 | #define regUVD_LMI_MMSCH_NC0_64BIT_BAR_HIGH 0x0901 |
|---|
| 1547 | #define regUVD_LMI_MMSCH_NC0_64BIT_BAR_HIGH_BASE_IDX 1 |
|---|
| 1548 | #define regUVD_LMI_MMSCH_NC1_64BIT_BAR_LOW 0x0902 |
|---|
| 1549 | #define regUVD_LMI_MMSCH_NC1_64BIT_BAR_LOW_BASE_IDX 1 |
|---|
| 1550 | #define regUVD_LMI_MMSCH_NC1_64BIT_BAR_HIGH 0x0903 |
|---|
| 1551 | #define regUVD_LMI_MMSCH_NC1_64BIT_BAR_HIGH_BASE_IDX 1 |
|---|
| 1552 | #define regUVD_LMI_MMSCH_NC2_64BIT_BAR_LOW 0x0904 |
|---|
| 1553 | #define regUVD_LMI_MMSCH_NC2_64BIT_BAR_LOW_BASE_IDX 1 |
|---|
| 1554 | #define regUVD_LMI_MMSCH_NC2_64BIT_BAR_HIGH 0x0905 |
|---|
| 1555 | #define regUVD_LMI_MMSCH_NC2_64BIT_BAR_HIGH_BASE_IDX 1 |
|---|
| 1556 | #define regUVD_LMI_MMSCH_NC3_64BIT_BAR_LOW 0x0906 |
|---|
| 1557 | #define regUVD_LMI_MMSCH_NC3_64BIT_BAR_LOW_BASE_IDX 1 |
|---|
| 1558 | #define regUVD_LMI_MMSCH_NC3_64BIT_BAR_HIGH 0x0907 |
|---|
| 1559 | #define regUVD_LMI_MMSCH_NC3_64BIT_BAR_HIGH_BASE_IDX 1 |
|---|
| 1560 | #define regUVD_LMI_MMSCH_NC4_64BIT_BAR_LOW 0x0908 |
|---|
| 1561 | #define regUVD_LMI_MMSCH_NC4_64BIT_BAR_LOW_BASE_IDX 1 |
|---|
| 1562 | #define regUVD_LMI_MMSCH_NC4_64BIT_BAR_HIGH 0x0909 |
|---|
| 1563 | #define regUVD_LMI_MMSCH_NC4_64BIT_BAR_HIGH_BASE_IDX 1 |
|---|
| 1564 | #define regUVD_LMI_MMSCH_NC5_64BIT_BAR_LOW 0x090a |
|---|
| 1565 | #define regUVD_LMI_MMSCH_NC5_64BIT_BAR_LOW_BASE_IDX 1 |
|---|
| 1566 | #define regUVD_LMI_MMSCH_NC5_64BIT_BAR_HIGH 0x090b |
|---|
| 1567 | #define regUVD_LMI_MMSCH_NC5_64BIT_BAR_HIGH_BASE_IDX 1 |
|---|
| 1568 | #define regUVD_LMI_MMSCH_NC6_64BIT_BAR_LOW 0x090c |
|---|
| 1569 | #define regUVD_LMI_MMSCH_NC6_64BIT_BAR_LOW_BASE_IDX 1 |
|---|
| 1570 | #define regUVD_LMI_MMSCH_NC6_64BIT_BAR_HIGH 0x090d |
|---|
| 1571 | #define regUVD_LMI_MMSCH_NC6_64BIT_BAR_HIGH_BASE_IDX 1 |
|---|
| 1572 | #define regUVD_LMI_MMSCH_NC7_64BIT_BAR_LOW 0x090e |
|---|
| 1573 | #define regUVD_LMI_MMSCH_NC7_64BIT_BAR_LOW_BASE_IDX 1 |
|---|
| 1574 | #define regUVD_LMI_MMSCH_NC7_64BIT_BAR_HIGH 0x090f |
|---|
| 1575 | #define regUVD_LMI_MMSCH_NC7_64BIT_BAR_HIGH_BASE_IDX 1 |
|---|
| 1576 | #define regUVD_LMI_MMSCH_NC_VMID 0x0910 |
|---|
| 1577 | #define regUVD_LMI_MMSCH_NC_VMID_BASE_IDX 1 |
|---|
| 1578 | #define regUVD_LMI_MMSCH_CTRL 0x0911 |
|---|
| 1579 | #define regUVD_LMI_MMSCH_CTRL_BASE_IDX 1 |
|---|
| 1580 | #define regUVD_MMSCH_LMI_STATUS 0x0912 |
|---|
| 1581 | #define regUVD_MMSCH_LMI_STATUS_BASE_IDX 1 |
|---|
| 1582 | #define regVCN_RAS_CNTL_MMSCH 0x0914 |
|---|
| 1583 | #define regVCN_RAS_CNTL_MMSCH_BASE_IDX 1 |
|---|
| 1584 | |
|---|
| 1585 | #define regVCN_UMSCH_MES_UTCL1_CNTL 0x0759 |
|---|
| 1586 | #define regVCN_UMSCH_MES_UTCL1_CNTL_BASE_IDX 1 |
|---|
| 1587 | #define regVCN_UMSCH_MES_BUSY 0x075a |
|---|
| 1588 | #define regVCN_UMSCH_MES_BUSY_BASE_IDX 1 |
|---|
| 1589 | #define regVCN_UMSCH_RB_BASE_LO 0x075b |
|---|
| 1590 | #define regVCN_UMSCH_RB_BASE_LO_BASE_IDX 1 |
|---|
| 1591 | #define regVCN_UMSCH_RB_BASE_HI 0x075c |
|---|
| 1592 | #define regVCN_UMSCH_RB_BASE_HI_BASE_IDX 1 |
|---|
| 1593 | #define regVCN_UMSCH_RB_SIZE 0x075d |
|---|
| 1594 | #define regVCN_UMSCH_RB_SIZE_BASE_IDX 1 |
|---|
| 1595 | #define regVCN_UMSCH_RB_RPTR 0x075e |
|---|
| 1596 | #define regVCN_UMSCH_RB_RPTR_BASE_IDX 1 |
|---|
| 1597 | #define regVCN_UMSCH_RB_WPTR 0x075f |
|---|
| 1598 | #define regVCN_UMSCH_RB_WPTR_BASE_IDX 1 |
|---|
| 1599 | #define regVCN_UMSCH_MASTINT_EN 0x0760 |
|---|
| 1600 | #define regVCN_UMSCH_MASTINT_EN_BASE_IDX 1 |
|---|
| 1601 | #define regVCN_UMSCH_IH_CTRL 0x0761 |
|---|
| 1602 | #define regVCN_UMSCH_IH_CTRL_BASE_IDX 1 |
|---|
| 1603 | #define regVCN_UMSCH_SYS_INT_EN 0x0762 |
|---|
| 1604 | #define regVCN_UMSCH_SYS_INT_EN_BASE_IDX 1 |
|---|
| 1605 | #define regVCN_UMSCH_SYS_INT_STATUS 0x0763 |
|---|
| 1606 | #define regVCN_UMSCH_SYS_INT_STATUS_BASE_IDX 1 |
|---|
| 1607 | #define regVCN_UMSCH_SYS_INT_ACK 0x0764 |
|---|
| 1608 | #define regVCN_UMSCH_SYS_INT_ACK_BASE_IDX 1 |
|---|
| 1609 | #define regVCN_UMSCH_SYS_INT_SRC 0x0765 |
|---|
| 1610 | #define regVCN_UMSCH_SYS_INT_SRC_BASE_IDX 1 |
|---|
| 1611 | #define regVCN_UMSCH_IH_CTX_CTRL 0x0766 |
|---|
| 1612 | #define regVCN_UMSCH_IH_CTX_CTRL_BASE_IDX 1 |
|---|
| 1613 | #define regVCN_UMSCH_CGC_CTRL 0x0767 |
|---|
| 1614 | #define regVCN_UMSCH_CGC_CTRL_BASE_IDX 1 |
|---|
| 1615 | #define regVCN_UMSCH_CGC_STATUS 0x0768 |
|---|
| 1616 | #define regVCN_UMSCH_CGC_STATUS_BASE_IDX 1 |
|---|
| 1617 | #define regVCN_UMSCH_CGC_MEM_CTRL 0x0769 |
|---|
| 1618 | #define regVCN_UMSCH_CGC_MEM_CTRL_BASE_IDX 1 |
|---|
| 1619 | #define regUVD_INTERNAL_REG_VIOLATION_8 0x076a |
|---|
| 1620 | #define regUVD_INTERNAL_REG_VIOLATION_8_BASE_IDX 1 |
|---|
| 1621 | #define regUVD_UMSCH_FORCE 0x076b |
|---|
| 1622 | #define regUVD_UMSCH_FORCE_BASE_IDX 1 |
|---|
| 1623 | #define regUVD_UMSCH_DEBUG_INDEX 0x076c |
|---|
| 1624 | #define regUVD_UMSCH_DEBUG_INDEX_BASE_IDX 1 |
|---|
| 1625 | #define regUVD_UMSCH_DEBUG_DATA_LO 0x076d |
|---|
| 1626 | #define regUVD_UMSCH_DEBUG_DATA_LO_BASE_IDX 1 |
|---|
| 1627 | #define regUVD_UMSCH_DEBUG_DATA_HI 0x076e |
|---|
| 1628 | #define regUVD_UMSCH_DEBUG_DATA_HI_BASE_IDX 1 |
|---|
| 1629 | #define regUVD_UMSCH_DEBUG_UTCL2_TCIU_IF 0x076f |
|---|
| 1630 | #define regUVD_UMSCH_DEBUG_UTCL2_TCIU_IF_BASE_IDX 1 |
|---|
| 1631 | #define regUMSCH_MES_RESET_CTRL 0x0770 |
|---|
| 1632 | #define regUMSCH_MES_RESET_CTRL_BASE_IDX 1 |
|---|
| 1633 | |
|---|
| 1634 | #define regVCN_MES_PRGRM_CNTR_START 0x0780 |
|---|
| 1635 | #define regVCN_MES_PRGRM_CNTR_START_BASE_IDX 1 |
|---|
| 1636 | #define regVCN_MES_INTR_ROUTINE_START 0x0781 |
|---|
| 1637 | #define regVCN_MES_INTR_ROUTINE_START_BASE_IDX 1 |
|---|
| 1638 | #define regVCN_MES_MTVEC_LO 0x0781 |
|---|
| 1639 | #define regVCN_MES_MTVEC_LO_BASE_IDX 1 |
|---|
| 1640 | #define regVCN_MES_INTR_ROUTINE_START_HI 0x0782 |
|---|
| 1641 | #define regVCN_MES_INTR_ROUTINE_START_HI_BASE_IDX 1 |
|---|
| 1642 | #define regVCN_MES_MTVEC_HI 0x0782 |
|---|
| 1643 | #define regVCN_MES_MTVEC_HI_BASE_IDX 1 |
|---|
| 1644 | #define regVCN_MES_CNTL 0x0787 |
|---|
| 1645 | #define regVCN_MES_CNTL_BASE_IDX 1 |
|---|
| 1646 | #define regVCN_MES_PIPE_PRIORITY_CNTS 0x0788 |
|---|
| 1647 | #define regVCN_MES_PIPE_PRIORITY_CNTS_BASE_IDX 1 |
|---|
| 1648 | #define regVCN_MES_PIPE0_PRIORITY 0x0789 |
|---|
| 1649 | #define regVCN_MES_PIPE0_PRIORITY_BASE_IDX 1 |
|---|
| 1650 | #define regVCN_MES_PIPE1_PRIORITY 0x078a |
|---|
| 1651 | #define regVCN_MES_PIPE1_PRIORITY_BASE_IDX 1 |
|---|
| 1652 | #define regVCN_MES_PIPE2_PRIORITY 0x078b |
|---|
| 1653 | #define regVCN_MES_PIPE2_PRIORITY_BASE_IDX 1 |
|---|
| 1654 | #define regVCN_MES_PIPE3_PRIORITY 0x078c |
|---|
| 1655 | #define regVCN_MES_PIPE3_PRIORITY_BASE_IDX 1 |
|---|
| 1656 | #define 0x078d |
|---|
| 1657 | #define 1 |
|---|
| 1658 | #define regVCN_MES_MIE_LO 0x078e |
|---|
| 1659 | #define regVCN_MES_MIE_LO_BASE_IDX 1 |
|---|
| 1660 | #define regVCN_MES_MIE_HI 0x078f |
|---|
| 1661 | #define regVCN_MES_MIE_HI_BASE_IDX 1 |
|---|
| 1662 | #define regVCN_MES_INTERRUPT 0x0790 |
|---|
| 1663 | #define regVCN_MES_INTERRUPT_BASE_IDX 1 |
|---|
| 1664 | #define regVCN_MES_SCRATCH_INDEX 0x0791 |
|---|
| 1665 | #define regVCN_MES_SCRATCH_INDEX_BASE_IDX 1 |
|---|
| 1666 | #define regVCN_MES_SCRATCH_DATA 0x0792 |
|---|
| 1667 | #define regVCN_MES_SCRATCH_DATA_BASE_IDX 1 |
|---|
| 1668 | #define regVCN_MES_INSTR_PNTR 0x0793 |
|---|
| 1669 | #define regVCN_MES_INSTR_PNTR_BASE_IDX 1 |
|---|
| 1670 | #define regVCN_MES_MSCRATCH_HI 0x0794 |
|---|
| 1671 | #define regVCN_MES_MSCRATCH_HI_BASE_IDX 1 |
|---|
| 1672 | #define regVCN_MES_MSCRATCH_LO 0x0795 |
|---|
| 1673 | #define regVCN_MES_MSCRATCH_LO_BASE_IDX 1 |
|---|
| 1674 | #define regVCN_MES_MSTATUS_LO 0x0796 |
|---|
| 1675 | #define regVCN_MES_MSTATUS_LO_BASE_IDX 1 |
|---|
| 1676 | #define regVCN_MES_MSTATUS_HI 0x0797 |
|---|
| 1677 | #define regVCN_MES_MSTATUS_HI_BASE_IDX 1 |
|---|
| 1678 | #define regVCN_MES_MEPC_LO 0x0798 |
|---|
| 1679 | #define regVCN_MES_MEPC_LO_BASE_IDX 1 |
|---|
| 1680 | #define regVCN_MES_MEPC_HI 0x0799 |
|---|
| 1681 | #define regVCN_MES_MEPC_HI_BASE_IDX 1 |
|---|
| 1682 | #define regVCN_MES_MCAUSE_LO 0x079a |
|---|
| 1683 | #define regVCN_MES_MCAUSE_LO_BASE_IDX 1 |
|---|
| 1684 | #define regVCN_MES_MCAUSE_HI 0x079b |
|---|
| 1685 | #define regVCN_MES_MCAUSE_HI_BASE_IDX 1 |
|---|
| 1686 | #define regVCN_MES_MBADADDR_LO 0x079c |
|---|
| 1687 | #define regVCN_MES_MBADADDR_LO_BASE_IDX 1 |
|---|
| 1688 | #define regVCN_MES_MBADADDR_HI 0x079d |
|---|
| 1689 | #define regVCN_MES_MBADADDR_HI_BASE_IDX 1 |
|---|
| 1690 | #define regVCN_MES_MIP_LO 0x079e |
|---|
| 1691 | #define regVCN_MES_MIP_LO_BASE_IDX 1 |
|---|
| 1692 | #define regVCN_MES_MIP_HI 0x079f |
|---|
| 1693 | #define regVCN_MES_MIP_HI_BASE_IDX 1 |
|---|
| 1694 | #define regVCN_MES_IC_OP_CNTL 0x07a0 |
|---|
| 1695 | #define regVCN_MES_IC_OP_CNTL_BASE_IDX 1 |
|---|
| 1696 | #define regVCN_MES_MCYCLE_LO 0x07a6 |
|---|
| 1697 | #define regVCN_MES_MCYCLE_LO_BASE_IDX 1 |
|---|
| 1698 | #define regVCN_MES_MCYCLE_HI 0x07a7 |
|---|
| 1699 | #define regVCN_MES_MCYCLE_HI_BASE_IDX 1 |
|---|
| 1700 | #define regVCN_MES_MTIME_LO 0x07a8 |
|---|
| 1701 | #define regVCN_MES_MTIME_LO_BASE_IDX 1 |
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